VHDL數(shù)字電路設(shè)計教程——國外電子與通信教材系列
作者：（巴西）佩德羅尼（Pedroni,V.A.） 著，喬廬峰 等譯
出版時間：2005
自從VHDL在1987年成為IEEE標(biāo)準(zhǔn)之后，就因其在電路模型建立、仿真、綜合等方面的強(qiáng)大功能而被廣泛用于復(fù)雜數(shù)字邏輯電路的設(shè)計中。本書共分為三個基本組成部分，首先詳細(xì)介紹VHDL語言的背景知識、基本語法結(jié)構(gòu)和VHDL代碼的編寫方法；然后介紹VHDL電路單元庫的結(jié)構(gòu)和使用方法，以及如何將新的設(shè)計加入到現(xiàn)有的或自己新建立的單元庫中，以便于進(jìn)行代碼的分割、共享和重用；最后介紹PLD和FPGA的發(fā)展歷史、主流廠商所提供的開發(fā)環(huán)境的使用方法。本書在內(nèi)容結(jié)構(gòu)的組織上有獨特之處，例如將并發(fā)描述語句、順序描述語句、數(shù)據(jù)類型與運算操作符和屬性等獨立成章，使讀者更容易清晰準(zhǔn)確地掌握這些重要內(nèi)容。本書注重設(shè)計實踐，給出了大量完整設(shè)計實例的電路圖、相關(guān)基本概念、電路工作原理以及仿真結(jié)果，從而將VHDL語法學(xué)習(xí)和如何采用它進(jìn)行電路設(shè)計有機(jī)地結(jié)合在一起。
本書適合通信工程、電子工程及相關(guān)專業(yè)的高年級本科生作為教材使用，同時也可以作為進(jìn)行可編程邏輯器件應(yīng)用開發(fā)的培訓(xùn)教材。
